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信號(hào)處理工程師

面議

/月

崗位職責(zé)：

1、負(fù)責(zé)算法設(shè)計(jì)與驗(yàn)證，完成信號(hào)處理的軟硬件方案設(shè)計(jì);

2、負(fù)責(zé)信號(hào)處理新技術(shù)和新算法研究;

3、完成項(xiàng)目中FPGA邏輯系統(tǒng)的編碼、集成、調(diào)試與測(cè)試;

4、負(fù)責(zé)信號(hào)處理方面的指標(biāo)分解、任務(wù)書下達(dá)、研制過(guò)程中的指導(dǎo)和把關(guān)以及測(cè)試和驗(yàn)收工作;

5、參與系統(tǒng)的集成聯(lián)試，并做好試驗(yàn)的分析、總結(jié)工作;

6、按照項(xiàng)目節(jié)點(diǎn)要求，根據(jù)技術(shù)文檔規(guī)范，獨(dú)立編寫相應(yīng)的技術(shù)文檔和說(shuō)明書;

 

任職資格：

1、本科及以上學(xué)歷，數(shù)字信號(hào)和模擬信號(hào)處理、雷達(dá)、通信、電子、控制等相關(guān)專業(yè);、

2、熟練掌握信號(hào)的傅里葉變換，頻譜(功率譜)分析，常見濾波器設(shè)計(jì)、放大器、數(shù)模模數(shù)轉(zhuǎn)換等信號(hào)處理問(wèn)題;

3、具備陣列信號(hào)處理、通信原理等領(lǐng)域知識(shí);

4、熟悉FPGA、ARM、DSP、STM3等嵌入式平臺(tái)開發(fā)流程，具有信號(hào)處理項(xiàng)目經(jīng)驗(yàn)

5、熟悉PID， lock-in amplifier等信號(hào)處理相關(guān)算法，并熟練使用MATLAB工具;

6、有實(shí)際整機(jī)項(xiàng)目(掃描探針顯微鏡等精密儀器或其他光機(jī)模組/設(shè)備)經(jīng)驗(yàn)者優(yōu)先;

7、 有對(duì)直流電機(jī)、伺服電機(jī)或壓電陶瓷掃描器等運(yùn)動(dòng)組件相關(guān)工作經(jīng)驗(yàn)者優(yōu)先;

 

其他備選條件參考：

1、熟悉verilog/vhdl硬件描述語(yǔ)言，熟悉FPGA開發(fā)流程、設(shè)計(jì)模式、體系結(jié)構(gòu);

2、熟悉vivado或libro、modelsim等開發(fā)工具的使用;

3、熟練使用萬(wàn)用表、示波器、頻譜儀、信號(hào)發(fā)送器等硬件調(diào)試設(shè)備;

聯(lián)系人：謝女士 15050531953(微信同號(hào))

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